[工程类试卷]注册电气工程师供配电公共基础(电气技术基础)模拟试卷7及答案与解析.doc
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1、注册电气工程师供配电公共基础(电气技术基础)模拟试卷 7 及答案与解析一、单项选择题1 同一差动放大电路中,采用哪种方式可使共模抑制比 Kcmr 最大?( )(A)单端输入(B)双端输入(C)单端输出(D)双端输出2 窆辑变量 X 与 1 异或结果是( ),与 0 异或的结果是 ( )。(A)0,1(B) 1,0(C) ,X(D)X,3 由图 758 所示数字逻辑信号的波形可知,三者的逻辑关系是( )。4 数字信号 B=1 时,如图 759 所示,两种基本门的输出为( )。(A)F 1=A,F 2=1(B) F1=1,F 2=A(C) F1=1,F 2=0(D)F 1=0,F 2=A5 对逻辑
2、表达式 ABC+ +B 的化简结果是( )。(A)AB(B) A+B(C) ABC(D)6 逻辑表达式 F= ,可以简化为 ( )。(A)F=A+B(B) F=(C) F=AB(D)F=7 下列逻辑代数基本运算关系式中不正确的是( )。(A)A+A=A(B) A.A=A(C) A+0=0(D)A+1=18 某逻辑问题的真值表见表 71,由此可以得到,该逻辑问题的输入输出之间的关系为( )。(A)F=0+1=1(B) F=ABC+(C) F= +ABC(D)F= +AB9 函数 Y= +ABC 的最简式为( )。(A)A+B+C(B)(C) ABC(D)110 逻辑函数 F= 的简化结果是 (
3、)。(A)F=AB+BC(B) F=(C) F=A+B+C(D)F=ABC11 函数 Y=AB+ 的最简式为( )。(A)AB(B)(C) AB+C(D)B+C12 下列命题中正确的是( )。(A)已知逻辑函数 A+B=A+C,则 B=C(B)已知逻辑函数 A+B=AB,则 A=B(C)已知逻辑函数 A+B=A,则 A=1(D)已知逻辑函数 AB=A,则 A=013 已知 Y=A+BC,则下列说法正确的是( )。(A)当 A=0、B=1、C=0 时,Y=1(B)当 A=0、B=0、C=1 时,Y=1(C)当 A=1、B=0、C=0 时,Y=1(D)当 A=1、B=0、C=0 时,Y=014 欲
4、使 JK 触发器按 Qn+1= 工作,可使 JK 触发器的输入端 ( )。(A)J=K=I(B) J=Q,K=(C) J=K=0(D)J=1,K=015 已知数字信号 X 和数字信号 Y 的波形如图 760 所示,则数字信号 F= 的波形为( )。16 基本门如图 761(a)所示,其中,数字信号 A 由图 761(b)给出,那么,输出F 为( )。17 某逻辑电路如图 762 所示,若输入 A=1,B=0 ,则输出 F1 和 F2 分别为( )。(A)F 1=0,F 2=0(B) F1=1,F 2=(C) F1=1,F 2=0(D)F 1=0,F 2=18 七段显示器的各段符号如图 763
5、所示,那么“E”的共阳极七段显示器的显示码abcdefg 应该是( )。(A)1001111(B) 0110000(C) 10110111(D)1000100119 下列电路中不属于时序逻辑电路的是( )。(A)计数器(B)全加器(C)寄存器(D)分频器20 JK 触发器及其输入信号波形如图 764 所示,那么,在 t=t0 和 t=t1 时刻,输出Q 分别为( ) 。(A)Q(t 0)=1,Q(t 1)=0(B) Q(t0)=0,Q(t 1)=1(C) Q(t0)=0,Q(t 1)=0(D)Q(t 0)=1,Q(t 1)=121 图 765(a)所示电路中,复位信号 、信号 A 及时钟脉信号
6、 CP 如图 765(b)所示,经分析可知,在第一个和第二个时钟脉冲的下降沿时刻,输出 Q 分别等于( )。(A)0 0(B) 0 1(C) 1 0(D)1 122 图 766(a)所示电路中,复位信号、数据输入及时钟脉信号如图 766(b)所示,经分析可知,在第一个和第二个时钟脉冲的下降沿过后,输出 Q 分别等于( )。附:触发器的逻辑状态表为(A)0 0(B) 0 1(C) 1 0(D)1 123 由 D 触发器的应用电路如图 767 所示,设触发器输出 Q 的初值为 0,在时钟CP 脉冲的作用下,输出 Q 为( )。(A)1(B) CP(C)脉冲信号,频率为时钟脉冲频率的 12(D)02
7、4 用 3 个 D 触发器组成的电路如图 768 所示,设 Q2Q1Q0 的初始状态为 000,触发器 F0 的输入端接 +5V 表明 D0=1,那么,在第 1 个 CP 脉冲和第 2 个脉冲的上升沿过后 Q2Q1Q0 分别是( ) 。(A)010 和 011(B) 010 和 001(C) 001 和 011(D)000 11125 用 3 个 D 触发器组成的电路如图 769 所示,触发器 F0 的输入端接+5V 表明D0=1,那么,在第 1 个 CP 脉冲和第 2 个脉冲的上升沿过后 Q2Q1Q0 分别是( )。(A)101 和 011(B) 011 和 111(C) 001 和 011
8、D)000 和 11126 如图 770 所示电路,Q 1、Q 0 的原始状态为 11,当输入两个脉冲后的新状态为( )。(A)00(B) 01(C) 11(D)1027 如图 771 所示,电路具有( )。(A)保持功能(B)置 “0”功能(C)置 “1”功能(D)计数功能28 如图 772 所示,时钟到来后,JK 具有( )功能。(A)输出保持(B)输出清“0”(C)输出置“1”(D)计数器29 如图 773 所示,时钟到来后,JK 具有( )功能。(A)输出保持(B)输出清“0”(C)输出置“1”(D)计数器30 在如图 774 所示的 RS 触发器,设 Q 的初始状态为 1,当输入
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