[工程类试卷]注册电气工程师供配电公共基础(电气技术基础)模拟试卷3及答案与解析.doc
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1、注册电气工程师供配电公共基础(电气技术基础)模拟试卷 3 及答案与解析一、单项选择题1 图 7-55(a)所示运算放大器的输出与输入之间的关系如图 7=55(b)所示,若 ui=2sintmV,则 u0 为( )。(A)(B)(C)(D)2 共集电极放大电路如图 756 所示。已知:=50,U BE=07V,当输入正弦电压有效值 Ui=75mV,输出电压有效值 U0 最接近于( )。(A)15V(B)一 07V(C)一 156mV(D)75mV3 如图 757 所示,将放大倍数为1,输入电阻为 1k,输出电阻为 50的射极输出器插接在信号源(u S,R S)与负载(RL)之间,形成图 (b)电
2、路,与图(a)电路相比,负载电压的有效值为( )。(A)U L2U L1(B) UL2=UL1(C) UL2U L1(D)因为 us 未知,不能确定 UL1 和 UL2 之间的关系4 为了稳定输出电压,提高输入电阻,放大电路应该引入下列负反馈中的( )。(A)电压串联(B)电压并联(C)电流串联(D)电流并联5 同一差动放大电路中,采用哪种方式可使共模抑制比 Xom。最大?( )(A)单端输入(B)双端输入(C)单端输出(D)双端输出6 逻辑变量 X 与 1 异或结果是( )。(A)0(B) 1(C)(D)X7 如图 7-58 所示,输出 F 与输入 A、B 的逻辑关系是( )。(A)F=A+
3、B(B)(C) F=ApB(D)F=AB8 如图 7-59 所示,输出 F 与输入 A、B 的逻辑关系是( )。(A)F=A+B(B)(C) F=ApB(D)F=AB9 逻辑表达式 F=AB,可以变换为( )。(A)(B)(C) F=A+B(D)10 逻辑表达式 F=A+B,可以变换为( )。(A)(B)(C) F=AB(D)11 下列逻辑代数基本运算关系式中不正确的是( )。(A)A+A=A(B) A.A=A(C) A+0=0(D)A 一 1=112 已知某逻辑电路的真值表见表 7-1,则该逻辑电路的最简逻辑表达式为( )。(A)BC+AC(B) A+B(C) AB+AC(D)B+C13 函
4、数 的最简式为( )。(A)A+B+C(B)(C) ABC(D)114 逻辑函数 的简化结果是( )。(A)F=AB+BC(B)(C) F=a+B+C(D)F=ABC15 函数 的最简式为( )。(A)AB(B)(C) AB+C(D)B+C16 下列命题中正确的是( )。(A)己知逻辑函数 A+B=A+C,则 B=C(B)已知逻辑函数 A+B=AB,则 A=B(C)己知逻辑函数 A+B=A,则 A=1(D)己知逻辑函数 AB=A,则 A=017 已知 Y=A+BC,则下列说法正确的是( )。(A)当 A=0、B=1、C=0 时,Y=1(B)当 A=0、B=0、C=1 时,Y=1(C)当 A=1
5、B=0、C=0 时,Y=1(D)当 A=1、B=0、C=0 时,Y=018 下列说法正确的是( )。(A)一个触发器可以有一个输出端,也可以有两个输出端(B)触发器两个输出端的电平可以相同,也可以相反(C)时钟信号决定了触发器的翻转时刻,控制输入信号决定了触发器翻转后的状态(D)时钟脉冲信号的触发都是上升沿触发19 逻辑电路和输入 A、B 的时序波形如图 7-60 所示,当输出 F 为高电平的时刻是 ( )。(A)h(B) t2(C) t2(D)t 420 基本门如图 7-61(a)所示,其中,数字信号 A 由图 7-61(b)给出,那么,输出 F 为( )。(A)1(B) 0(C)(D)2
6、1 某逻辑电路如图 762 所示,若输入A=1,B=0 ,则输出 F1 和 F2 分别为( )。(A)F 1=0,F 2=0(B) F1=1,(C) F1=1,F 2=0(D)F 1=0,22 如图 7-63 所示,输出端 Y1 的逻辑表达式为( )。(A)A.B(B)(C) A+B(D)23 逻辑表达式 化简后的结果是( )。(A)B+C(B) 0(C) 1(D)24 由开关组成的电路如图 764 所示,设开关合上为“1”,断开为“0”;电灯亮为“1”,灭为“0”。则该电路的逻辑关系是( )。(A)HL=AB+C(B) HL=A+BC(C) HL=A(B+C)(D)HL=ABC25 某计数器
7、最大输入脉冲为 30,组成该计数器需要( )个触发器。(A)2(B) 3(C) 4(D)526 由 8 个 JK 触发器构成的二进制计数器,其计数范围是( )。(A)18(B) 1256(C) 0255(D)025627 如图 7-65 所示电路中,两个 D 触发器在接受触发脉冲前为均为 0,分析电路,该电路是( )。(A)异步二进制计数器(B)左移计数器(C)右移计数器(D)同步三进制计数器28 用 3 个 D 触发器组成的电路如图 7-66 所示,设 Q2Q1Q0 的初始状态为 000,触发器 F0 的输入端接+5V 表明 D0=1,那么,在第1 个 CP 脉冲和第 2 个脉冲的上升沿过后
8、 Q2Q1Q0 分别是( )。(A)010 和 011(B) 010 和 001(C) 001 和 011(D)000 和 11129 用 3 个 D 触发器组成的电路如图 7-67 所示,触发器 F0 的输入端接 +5V 表明 D0=1,那么,在第 1 个 CP 脉冲和第 2 个脉冲的上升沿过后 Q2Q1Q0 分别是( )。(A)101 和 011(B) 011 和 111(C) 001 和 011(D)000 和 11130 由 D、JK 触发器组成的逻辑电路如图 7-68所示,Q 1、Q 2 的初始状态为 00,D=1,当第一个脉冲和第二个脉冲作用后,Q1、Q 2 分别变为( ) 。(A
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